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公告: CrazyFPGA积分拉力赛，截至3.31前，前10名送CrazyBingo签名珍藏版《设计→图像→时序》3/2/1本书	CrazyBingo 2025-3-14

vivado编译报错导致编译中断 ...2	shero_22 2025-3-20	16254	CrazyTiming 昨天 21:02
请教：关于AD9172 JESD 断链的问题 New	CrazyClock 5 天前	4103	CrazyClock 昨天 14:37
ILA数据深度设置 New	琴是晴天的情 4 天前	4103	琴是晴天的情前天 00:07
用复旦微7020片子，PS侧PLL的问题 New	xghuhu0422 5 天前	5172	xghuhu0422 3 天前
在AI的浪潮中，FPGA是否能吃上这蛋糕？ ...2	yao 2025-3-18	15388	琴是晴天的情 3 天前
FPGA硬件加速 ...2	琴是晴天的情 2025-3-16	19421	琴是晴天的情 4 天前
Xilinx烧录验证 New	always@ 5 天前	1134	CrazyBingo 5 天前
FPGA复位策略	GET 2025-3-22	9685	GET 5 天前
MODELSIM使用技巧	seanhu 2025-3-21	6238	FPGA低才生 5 天前
vivado编译完成后提示音	seanhu 2025-3-21	2144	IC牛马 5 天前
modelsim打开和生成VCD文件的方法	seanhu 2025-3-21	297	xxppno1 2025-3-22 14:38
FPGA笔记模板	seanhu 2025-3-21	1132	CrazyBingo 2025-3-22 14:30
操作程序FLASH时第一次操作会失败	FPGA低才生 2025-3-21	4112	FPGA低才生 2025-3-22 11:35
FPGA设计需要什么样的电脑配置 ...2	一介散修 2025-3-16	11275	seanhu 2025-3-21 15:44
位宽转换 ...2	Sue 2025-3-19	17266	klxh 2025-3-21 14:42
vivado波形中marker显示不完整	yao 2025-3-20	2145	yao 2025-3-21 09:34
【奥唯思】奥唯思各XLILINX开发板FLASH型号，程序固化必看！！！	CrazyStuff 2025-3-20	2163	xghuhu0422 2025-3-21 09:24
【奥唯思】VF-X100K676使用指南	CrazyStuff 2025-3-20	1148	CrazyBingo 2025-3-20 22:47
Vivado综合ROM模型，必须初始化，否则ROM会被优化	CrazyTiming 2025-3-11	4444	xxppno1 2025-3-20 18:35
常用XDC约束	CrazyClock 2025-3-17	5228	GET 2025-3-20 14:52

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